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20 nm Device Portfolio
Arria 10 SX SoC Features
Maximum Resource Count for Arria 10 SX SoC 1
10AS016
10AS022
10AS027
10AS032
10AS048
10AS057
10AS066
Central processing unit (CPU) core
CPU cache and Co-processors
Scratch pad RAM
HPS DDR memory
Direct Memory Access (DMA) controller
EMAC
USB On-The-Go controller (OTG)
UART controller
Serial Peripheral Interface (SPI) controller
I 2 C controller
Quad SPI flash controller
SD/SDIO/MMC controller
NAND flash controller
General-purpose timers
Software-programmable general-purpose
I/Os (GPIOs)
Direct shared I/Os
Watchdog timers
Security
Dual-core ARM Cortex-A9 MPCore processor
L1 instruction cache (32 KB)
L1 data cache (32 KB)
Layer 2 cache (512 KB) shared
Floating-point unit (FPU) single and double precision
ARM Neon? media engine
ARM CoreSight? debug and trace technology
Snoop control unit (SCU)
Acceleration coherency port (ACP)
256 KB
DDR4 and DDR3 (Up to 64 bit with ECC)
8-channel
3 x 10/100/1000 EMAC with integrated DMA
2 x USB OTG with integrated DMA
2 x UART 16550 compatible
4 x SPI
5 x I 2 C
1 x SIO, DIO, QIO SPI flash supported
1 x eMMC 4.5 with DMA and CE-ATA support
1 x ONFI 1.0 or later
8 and 16 bit support
7X
Max 54 GPIO
48 I/O to connect HPS peripherals directly to I/O
4X
Secure b oot,  Advance d Encryption Standard (AES) and SHA
1
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